分频【FPGA】"/>
5分频【FPGA】
所以数据对齐晶振。
从第一个晶振开始：
5分频：
2.5晶振高电平，2.5晶振低电平
clk1是 3+2
clk2是2+3
需要 clk2下降沿【拉低】clk1上升沿【拉高】
clk_out = clk1 & clk2;
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